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portada ASIC-Implementierung des Pezaris-Multiplikators in DIT-FFT-Architekturen (in German)
Type
Physical Book
Author
Publisher
Language
Alemán
Pages
52
Format
Paperback
Dimensions
22.9 x 15.2 x 0.3 cm
Weight
0.09 kg.
ISBN13
9786205647936
Categories

ASIC-Implementierung des Pezaris-Multiplikators in DIT-FFT-Architekturen (in German)

Saranya Karunamurthi (Author) · Vinoth Kumar Bojan (Author) · Baby Janagam Ramachandran (Author) · Verlag Unser Wissen · Paperback

ASIC-Implementierung des Pezaris-Multiplikators in DIT-FFT-Architekturen (in German) - Karunamurthi, Saranya ; Bojan, Vinoth Kumar ; Ramachandran, Baby Janagam

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Synopsis "ASIC-Implementierung des Pezaris-Multiplikators in DIT-FFT-Architekturen (in German)"

Multiplikatoren mit gro en Bitlängen haben einen gro en Einfluss auf die Leistung digitaler Schaltungen in vielen Anwendungen wie Kryptographie, digitale Signalverarbeitung und Bildverarbeitung. Die Leistung vieler Berechnungsprobleme wird häufig von der Geschwindigkeit bestimmt, mit der eine Multiplikationsoperation ausgeführt werden kann. Dieses Buch gibt einen kurzen Überblick über verschiedene Multiplikatoren wie Baugh-Woley-, Pezaris-, Array-, Booth-, Vedic-Multiplikatoren und Kompressor-basierte Multiplikatoren. Das Hauptziel besteht darin, verschiedene Arten von Multiplizierern in Bezug auf Leistungsaufnahme, Fläche und Verzögerung zu vergleichen. Diese vorzeichenbehafteten Multiplikationskonzepte werden in Verilog HDL implementiert und in Cadence RTL Compiler mit 180nm Technologie umgesetzt.

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